壓敏電阻采購,就選源林電子,自有工廠
ZnO壓敏電阻器的結構:
晶粒體為電阻率很低的半導體,晶界為絕緣體,類似邊界層電容器,另在晶界形成兩背靠背的肖特基勢壘。因鄰近晶粒的取向不同,兩晶粒交界處結構松弛,雜質占據這些位置比占據體內晶格位置的能量低,所以容易在晶界偏析。
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低電場區域的漏電流
漏電流包括阻性和容性兩部分,交流電壓下容性電流比阻性電流大得多。溫度升高或電場增大,阻性電流增大。壓敏電壓的溫度系數在-10-4/℃—-10-3/℃之間,計算公式如下:
T=dU1mA/(U1mAdT)
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限制電壓Up
限制電壓(V)指壓敏電阻器兩端所能承受的電壓值。限制電壓Up是殘壓UR的一種特殊形式,也是考核特定規格的壓敏電阻抑制瞬態過電壓能力的特征指標。限制電壓Up實際上是生產廠家向用戶承諾的每個規格產品的保護電壓水平。
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